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EDA实验报告——计数器
1、模323计数器设计实验报告实验内容在QuartusII平台上，利用VHDL代码实现学号323计数器的设计，并在三位数码管显示出来。实验步骤与过程分析建立工程。
2、实验四 七段数码管显示电路实验目的实现十六进制计数显示。硬件需求EDA/SOPC实验箱一台。实验原理七段数码管分共阳极与共阴极两种。
3、数字电路实验报告计数器逻辑功能及其应用实验目的：熟悉中等规模集成电路计数器74LS160的逻辑功能，使用方法及应用。掌握构成任意进制计数器的方法。
很简单的一个VHDL代码:数码管显示
七段数码管显示数字需要自定义一个译码器。把二进制数字转换为对应显示的abcdefgh。例如：想显示‘1’需要给七段数码管（共阴极）输入01100000，‘2’需要11011010等等。
首先编写分频计程序（50M或27M分频到1HZ）编写减法器，预置数为9。减法器减到0时，设一个输出为，例如为OUTY，减到0时候，OUTY为高电平（设置让其持续几秒）。当前计数器数字输出通过数码管译码程序，使其在数码管显示。
我这里有一个自己弄的现成的程序。可以给你看看。首先是你要有数码管译码器，以下这个是共阴数码管的译码电路的VHDL。segin是输入的你要显示的二进制数据，比如1001代表的就是9。seg就是输出的点亮七段数码管的信号。
下面是一个简单的 Verilog HDL 代码，可以实现六位数码管动态显示从左到右为123456的效果。
VHDL设计简易数字频率计,要求四位数码管输出,量程1—20KHz,有占空比显示...
在它的高电平的时间内，用一个标准频率的信号源作为计数器的时钟脉冲。若计数结果为N，标准信号频率为f1，则被测信号的周期为：T=T1·N。被测信号的频率为：f=1/T1·N=f1/N。
简易频率计 设计任务与要求 1．设计制作一个简易频率测量电路，实现数码显示。2．测量范围：10Hz~999KHz 3．测量精度： 10Hz。 输入信号幅值：20mV~5V。 显示方式：4位LED数码。
在数码显示管上可以看到计数结果。3设计实现1系统方框图的划分和结构设计 根据数字频率计的系统原理框图（图1虚线框内），设计系统的顶层电路图如图2所示。
数字频率计用于测量信号（方波，正弦波或其他周期信号）的频率，并用十进制数字显示，它具有精度高，测量速度快，读数直观，使用方便等优点。
多功能数字钟的主要功能如下：（1）计时和校时，时间可已24h制或12h制显示。...设计内容及设计方案 （一）设计内容要求 设计一个有“时”、“分”...例如：电路中的石英晶体振荡频率是4MHz时，则电路的输出频率为4MHz。
这0个信号可以由一个测频控制信号发生器产生，即图7-1中的TESTCTL，它的设计要求是，TESTCTL的计数使能信号CNT_EN能产生一个1秒脉宽的周期信号，并对频率计的每一计数器CNT10的ENA使能端进行同步控制。
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